可以在桌面增加一个钟表,数十种风格:表盘式、数字式、古典式、现代式。还可以显示世界百多个城市的时间,配有时区地图标示。如果计划国际旅行,非常实用。
2021-08-02 12:37:25 11.96MB 桌面 全球 时钟 Clock
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非常简单,没用clock函数
2021-07-25 17:03:05 3KB C++
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UDS诊断协议:ISO 14229-8-2020 Road vehicles — Unified diagnostic services (UDS) _Part 8:UDS on Clock eXtension Peripheral Interface (UDSonCXPI) 标准内容高清可复制,非扫描版。
2021-07-19 09:02:50 4.09MB UDS 汽车诊断 ISO14229
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学习软件_早教启蒙_Animated Clock免费下载.zip
2021-07-15 20:02:33 1.86MB 学习软件_早教启蒙_Animat
QT creator 时钟制作,C++代码 可以运行的代码!
2021-07-13 10:20:06 370KB QT clock 时钟
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基于FPGA的数字钟万年历Verilog资料合集,包含源码工程、仿真工程、视频教程、原理图PCB图,是FPGA经典案例系列博客的其中资源之一,系列博客地址:https://blog.csdn.net/qq_33486907/article/details/118653742 欢迎浏览。 由于资源过大超过CSDN 1000M的限制,所以此资源为压缩卷第一卷,第二卷地址为: https://download.csdn.net/download/qq_33486907/20203123 两卷要放在同一个文件夹下才能解压成功。
2021-07-12 09:01:52 900MB FPGA verilog
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基于FPGA的数字钟万年历Verilog资料合集,包含源码工程、仿真工程、视频教程、原理图PCB图,是FPGA经典案例系列博客的其中资源之一,系列博客地址:https://blog.csdn.net/qq_33486907/article/details/118653742 欢迎浏览。 由于资源过大超过CSDN 1000M的限制,所以此资源为压缩卷第二卷,第一卷地址为:https://download.csdn.net/download/qq_33486907/20203102 两卷要放在同一个文件夹下才能解压成功。
2021-07-12 09:01:52 680.16MB FPGA verilog
hone hone clock 趣味时钟 在页面引用下即可
2021-07-10 09:53:21 35KB hone hone clock 趣味时钟
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workload是模拟系统运行时可能出现的逻辑页号。
2021-07-08 10:35:37 349KB 模拟页面置换
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