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硬件VHDL语言滚动学号的实现
关于硬件的实验,是老师布置的大作业,该算法采用VHDL语言,连接试验箱可以实现LED数码管滚动学号。简单方便,都是平时学习的内容。
2021-11-06 18:51:30
1.49MB
VHDL
滚动学号
1
用VHDL语言设计数字秒表
很简单的实现基本功能的数字秒表用用VHDL语言设计
2021-11-06 10:16:36
119KB
数字秒表
1
基于VHDL语言的数字频率计的设计方案
本文提出了一种基于VHDL语言的数字频率计的设计方案,该方案通过采用自顶向下的设计方法,用VHDL语言对状态机、计数器、十分频、同步整形电路等进行编程,用QuartusⅡ对状态机、计数器、同步整形电路、分频电路进行仿真,在FPGA上采用高频测频、低频测周、中间十分频转换的方法,设计出体积较小,性能更可靠的数字频率计。经过电路仿真和硬件测试验证了方案的可行性。
2021-10-31 22:19:00
526KB
VHDL语言
数字频率计
设计
文章
1
用VHDL语言实现的ALU
这个ALU用了三种描述方法来进行描述,分别为行为描述,数据流描述,结构描述,同时这个ALU实现的功能就是74181的功能
2021-10-31 18:16:06
1.82MB
VHDL
74181
ALU
1
史上最牛的VHDL语言100例详解
史上最牛的VHDL语言100例详解的电子书,该书为翻译本,原版为英文的,若想看的更加明白,还是买本原版的要好点,翻译过来的多少会有点问题的。
2021-10-29 15:13:37
7.38MB
VHDL
、FPGA、CPLD、DSP、单片机、等
1
VHDL语言设计数字跑表的源代码
VHDL语言设计数字跑表的源代码,通过VHDL语言实现数字跑表的功能
2021-10-28 10:00:22
238KB
数字跑表
VHDL
1
60进制和24进制计数器基于VHDL语言编写
60进制和24进制计数器基于VHDL语言编写 60进制和24进制计数器基于VHDL语言编写
2021-10-27 22:58:02
229KB
60进制和24进制计数器基于VHDL语言编写
1
24进制计数器(基于VHDL语言)
24进制计数器(基于VHDL语言)用VHDL语言书写
2021-10-27 22:17:41
141KB
24进制计数器(基于VHDL语言)
1
基于VHDL语言的EDA秒表作业设计
基于VHDL语言的EDA秒表作业设计,包括分频、秒表主体和数码管显示译码器,附有工程文件和管脚信息(EDA大作业西电02105143)
2021-10-27 17:55:57
423KB
VHDL语言
EDA秒表
1
vhdl语言的按键消抖
vhdl语言编写的按键消抖程序, 还有进行元件例化直接生成3个按键操作
2021-10-25 18:24:34
353KB
按键消抖
vhdl
1
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