本书主要介绍Altera公司的软核CPU——Nios和采用该CPU进行嵌入式系统设计的流程与方法。并以此为着眼点,介绍Altera的片上可编程系统SOPC的设计原理与实践技术,引领读者在低投入的情况下,较快地进入片上系统SOC的殿堂。 本书以Altera公司的技术资料为蓝本,由浅入深地阐述了Nios软核处理器的CPU结构、总线传输模式以及相关外设。同时也简要说明了软件的开发过程。既可作为学习Nios处理器的入门指导书,也可作为设计参考手册。 本书附录中刊载了Altera 2003年Nios嵌入式软核心处理器设计大赛中中国大陆赛区和中国台湾赛区的全部获奖者撰写的,读者可以从中获得有益的启示。 本书附带一张光盘,包含了Altera提供的2004年新版QuartusII 4.0软件和Nios处理器的开发包,读者可以藉此开始SOPC的旅程。 本书可供电子和通信等领域从事硬件设计和系统开发的工程技术人员和教师阅读参考,也可以作为相关专业研究生和高年级本科生的教材。
2021-11-20 14:12:35 20.99MB FPGA SOC NIOS SOPC
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NIOS II开发指南,基础
2021-11-19 09:01:31 12.89MB NIOS FPGA SOC SOPC
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nios-spi-adc7928,三种工作方式。
2021-11-08 10:08:35 1KB nios
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勇敢的芯伴你玩转NIOS II pdf版本,有需要的拿去。
2021-11-04 10:02:35 83.79MB fpga altera niosII 勇敢的芯
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NIOS_SPI_手册
2021-10-28 17:42:33 155KB NIOS_SPI
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Nios II中,我们可以通过Nios II 中的flash烧写功能往FPGA中固化程序和系统参数,如果我们想单独烧写系统参数呢?就是想在flash或者EPCS的空闲区域写入二进制数据。在软件中我们可以将flash中的数据读出来,那怎样才能烧写有用的数据呢。下面就八一八。
2021-10-27 10:02:10 62KB NIOSII 烧写 二进制文件 FLASH
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详细介绍nois多种设置复位地址,异常地址,以及相应的bsp-editor 设置方法
2021-10-18 17:02:22 200KB nios bsp-editor boot
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以Altera公司的Quartus Ⅱ 7.2作为开发工具,研究了基于FPGA的DDS IP核设计,并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件,结合32位嵌入式CPU软核Nios II,构成可编程片上系统(SOPC),利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片内完成,利用 SOPC技术,在一片 FPGA 芯片上实现了整个信号源的硬件开发平台,达到既简化电路设计、又提高系统稳定性和可靠性的目的。
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学习FPGA+nios的必备,想学SOPC的请进
2021-10-16 14:40:06 1.57MB 详细
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基于NiosⅡ软核处理器的通信信号源SOPC设计.pdf
2021-10-08 23:14:16 261KB 处理器 微型机器 数据处理 参考文献