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简单乘法器和除法器的FPGA设计
乘法器的设计思想,其实就是把乘法还原成加法来实现。注意一点,就是进入乘法器的数据和结果数据,要在正确的时间提取。乘法不能过快,要慢于计算周期。简单除法的思想,就是将除法,还原为减法的过程。
2020-01-03 11:29:35
304KB
FPGA
Verilo
串行乘法器
简单除法器
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