逻辑设计基础

上传者: zgwanchiyu | 上传时间: 2021-08-27 12:01:09 | 文件大小: 361KB | 文件类型: RAR
Verilog初级,适合于入门级选手打基础

文件下载

资源详情

[{"title":"( 2 个子文件 361KB ) 逻辑设计基础","children":[{"title":"VERILOG快速入门","children":[{"title":"VERILOG快速入门","children":[{"title":"Verilog基础知识.pdf <span style='color:#111;'> 316.61KB </span>","children":null,"spread":false},{"title":"Verilog HDL练习题.pdf <span style='color:#111;'> 98.59KB </span>","children":null,"spread":false}],"spread":true}],"spread":true}],"spread":true}]

评论信息

  • u012933273 :
    楼主好人啊~~ 最近在学数字系统设计这门课 有用~~
    2013-11-25

免责申明

【只为小站】的资源来自网友分享,仅供学习研究,请务必在下载后24小时内给予删除,不得用于其他任何用途,否则后果自负。基于互联网的特殊性,【只为小站】 无法对用户传输的作品、信息、内容的权属或合法性、合规性、真实性、科学性、完整权、有效性等进行实质审查;无论 【只为小站】 经营者是否已进行审查,用户均应自行承担因其传输的作品、信息、内容而可能或已经产生的侵权或权属纠纷等法律责任。
本站所有资源不代表本站的观点或立场,基于网友分享,根据中国法律《信息网络传播权保护条例》第二十二条之规定,若资源存在侵权或相关问题请联系本站客服人员,zhiweidada#qq.com,请把#换成@,本站将给予最大的支持与配合,做到及时反馈和处理。关于更多版权及免责申明参见 版权及免责申明