秒表程序Verilog语言编写 FPGA
本程序是我利用Quartus II软件用Verilog
语言编写的秒表程序，这是我们学校组织的
FPGA专周的设计题目。（已经下载到实验箱
实际运行通过了的；程序算法全部很简单，
方便阅读、更改，【呵呵 还是主要因为本
人能力有限】）
题目要求如下：
1．要有百分秒、秒、分、小时（我设计的是二十四小时）。
2. 要有清零按钮和暂停按钮。
3. 下载，检查功能直到正确。
4. 数显以动态扫描显示输出。（七段码数显）
【注意！注意！注意】：下载后运行.....
文件下载
评论信息
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gezix1412 :懂程序，对我很有帮助，谢谢了！懂程序，对我很有帮助，谢谢了！懂程序，对我很有帮助，谢谢了！2014-06-26 -
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cc1257314857 :很不错，找了很久，程序简单易懂，可以用2014-06-04
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taoxiner :太给力了。程序给力2013-09-20
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dingkun03 :不错的程序，很容易懂，可以使用2012-12-23
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yuchixiaoxian :很易懂程序，对我很有帮助，谢谢了！2012-08-11
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