用Verilog写的等效采样程序

上传者: yw703 | 上传时间: 2019-12-21 22:15:19 | 文件大小: 2.34MB | 文件类型: rar
用Verilog写的等效采样程序,对需要写等效采样的朋友很有帮助,更好的理解等效采样技术

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评论信息

  • wxn19881011 :
    正在看,感觉有点乱,慢慢学吧
    2017-06-15
  • wxn19881011 :
    正在看,感觉有点乱,慢慢学吧
    2017-06-15
  • fdsarewq :
    为了电子大赛下载来做参考的,结构上有点参考作用
    2015-10-13
  • 远方_ :
    为了电子大赛下载来做参考的,结构上有点参考作用
    2015-10-13
  • hero19820708 :
    VHDL写的,而且没有说采样精度
    2015-08-29
  • 彳亍11 :
    VHDL写的,而且没有说采样精度
    2015-08-29
  • ctianjiang :
    很实用,不过需要时间分析代码
    2015-07-02
  • ctianjiang :
    很实用,不过需要时间分析代码
    2015-07-02
  • taoyingjian :
    VHDL的,不是我想要的
    2013-10-21
  • taoyingjian :
    VHDL的,不是我想要的
    2013-10-21

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