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基于booth算法的乘法器的verilog实现
基于booth算法的乘法器的verilog实现
上传者:
47989126
|
上传时间: 2021-05-11 17:20:29
|
文件大小: 2KB
|
文件类型: V
Booth
乘法器
verilog
8位Booth乘法器设计,8位乘8位的基2的booth乘法器的verilog实现。满足1)利用硬件描述语言描述8位数乘法器运算;2)输入为复位信号、乘法执行按键;3)时钟信号为开发板上时钟信号。
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