32位浮点数加法器_system verilog.zip

verilog 浮点数加法器 systemverilog

32位浮点数加法器基于system verilog，可以实现串行输入的两个标准化的32位浮点数的相加并得到标准化的结果。此外该加法器能处理“特殊”数字:零、正无穷、负无穷和“非数字(NaN)”。本文件带测试代码

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[{"title":"（ 2 个子文件 3KB ） 32位浮点数加法器_system verilog.zip","children":[{"title":"32位浮点数加法器_system verilog","children":[{"title":"fpadder.sv <span style='color:#111;'> 4.15KB </span>","children":null,"spread":false},{"title":"fpadder_test.sv <span style='color:#111;'> 2.08KB </span>","children":null,"spread":false}],"spread":true}],"spread":true}]

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