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华南理工大学VHDL实验数码管与分频器
华南理工大学VHDL实验数码管与分频器
上传者:
43912252
|
上传时间: 2019-12-21 21:49:39
|
文件大小: 809KB
|
文件类型: docx
华南理工
VHDL
数码管
分频器
(1)利用硬件描述语言设计分频器模块和七段显示码模块; (2)学习数码管驱动芯片74HC595的时序,请同学根据时序写出VHDL代码; (3)设计数据产生模块,每秒输出数字加1; (4)设计顶层文件,驱动数码管模块,使(3)产生数据显示在数码管上。
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