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四位全加器电路及版图的设计与验证(数字集成电路实验报告—曹鹏益.doc)
四位全加器电路及版图的设计与验证(数字集成电路实验报告—曹鹏益.doc)
上传者:
42497075
|
上传时间: 2019-12-21 21:45:51
|
文件大小: 885KB
|
文件类型: docx
数字芯片设计
1、单元电路实现,两种实现方式都可以,一:2输入门;二:复杂CMOS门。 2、由单元电路连接成4位加法器。 3、Chartered 0.35工艺。 4、通过波形仿真、DRC、LVS。 首先熟悉cadence软件的使用,练习反相器的原理图和版图绘制,并仿真,运行DRC LVS 规则检查。
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