UART:VHDL中的简单UART实现
串口
VHDL中的简单UART实现
描述
非常简单，无缓冲的8位数据位，0位奇偶校验，1位停止位串行通信通道的实现。 通过分别设置I_clk_baud_count，应该能够在任何波特率下（有一定程度的错误）：
For a 50MHz I_clk:
I_clk_baud_count := X"1458" -- 9600bps
I_clk_baud_count := X"01B2" -- 115200bps
To generate other timings, perform calculation:
/ = I_clk_baud_count
50000000 / 9600 = 5208 (0x1458)
＃输入/输出：
SYS
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资源详情
[{"title":"（ 5 个子文件 7KB ） UART:VHDL中的简单UART实现","children":[{"title":"UART-master","children":[{"title":"vhdl","children":[{"title":"uart_simple.vhd <span style='color:#111;'> 7.12KB </span>","children":null,"spread":false}],"spread":true},{"title":"README.md <span style='color:#111;'> 1.77KB </span>","children":null,"spread":false},{"title":"tests","children":[{"title":"uart_simple_loopback_tb.vhd <span style='color:#111;'> 4.74KB </span>","children":null,"spread":false},{"title":"uart_simple_rx_tb.vhd <span style='color:#111;'> 3.83KB </span>","children":null,"spread":false},{"title":"uart_simple_tx_tb.vhd <span style='color:#111;'> 3.44KB </span>","children":null,"spread":false}],"spread":true}],"spread":true}],"spread":true}]
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