EDA/PLD中的基于CPLD的异步串行收发器设计

上传者: 38652870 | 上传时间: 2022-07-17 23:56:13 | 文件大小: 90KB | 文件类型: PDF
摘要:介绍了基于CPLD的异步串行收发器的设计方案,着重叙述了用混合输入(包括原理图和VHDL)实现该设计的思想,阐述了在系统可编程(ISP)开发软件的应用方法与设计流程,并给出了VHDL源文件和仿真波形。 关键词:异步串行收发器;混合输入;在系统可编程;CPLD;ispLSI1016传统数字系统的设计主要基于标准逻辑器件并采用“Bottom-Up”(自底向上)的方法构成系统。这种“试凑法”设计无固定套路可寻,主要凭借设计者的经验。所设计的数字系统虽然不乏构思巧妙者,但往往要用很多标准器件,而且系统布线复杂,体积功耗大,可靠性差,相互交流和查错修改不便,设计周期也长。随着电子技术的发展,

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