一种多路分时复用抗混叠滤波器设计与实现

数字滤波器； FPGA；

一种多路分时复用抗混叠滤波器针对应用于飞行试验的网络化机载采集系统中数字信号混叠问题，采用变采样率的抗混叠滤波器的设计，解决在数字信号处理过程中由于采样率过高，在进行整数倍抽取时有可能会出现数字信号混叠问题。同时将数字滤波器通过FPGA实现，实现了多路分时复用功能，支持8路同步采样数据的数字信号处理，并进行滤波器特性测试，对于8 kHz的原始信号，半带滤波器的截止频率为Fs/4，即2 kHz，经过系统后的-3 dB对应的信号频率2 048 Hz，幅频特性曲线与Matlab仿真结果一致。

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