基于FPGA的DDR3多端口读写存储管理的设计与实现

上传者: 38506798 | 上传时间: 2021-06-04 20:56:59 | 文件大小: 90KB | 文件类型: PDF
为了解决视频图形显示系统中多个端口访问DDR3的数据存储冲突,设计并实现了基于FPGA的DDR3存储管理系统。DDR3存储器控制模块使用MIG生成DDR3控制器,只需通过用户接口信号就能完成DDR3读写操作。DDR3用户接口仲裁控制模块将中断请求分成多个子请求,实现视频中断和图形中断的并行处理。帧地址控制模块确保当前输出帧输出的是最新写满的帧。

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