使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用

上传者: wdd1yx | 上传时间: 2019-12-21 18:56:33 | 文件大小: 823KB | 文件类型: rar
使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用

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评论信息

  • qiuqiuqiuqiu11122233 :
    可以用吗,是不是我下的不对,打不开啊
    2018-01-23
  • Odysseus_Arky :
    试试有没有效果
    2017-11-29
  • bo_bai :
    不错,有帮助
    2017-11-15
  • qingdiwushuang :
    挺棒的,虽然跟需求还是有一些差别,但是给了很强的指导作用
    2014-08-13
  • leeboyjcc :
    不错,可移植性很好
    2014-05-26

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