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verilog编写的伪随机序列发生器
verilog编写的伪随机序列发生器
上传者:
tian_jie
|
上传时间: 2021-11-30 15:02:17
|
文件大小: 1KB
|
文件类型: -
verilog
伪随机
此程序是用verilog语言实现的伪随机序列,程序里面对同步字节、数据包、数据帧都有说明,使得程序明白易懂。 此程序是用verilog语言实现的伪随机序列,程序里面对同步字节、数据包、数据帧都有说明,使得程序明白易懂。
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