SystemVerilog 3.1a 语言参考手册【中文版】
随着FPGA和ASIC开发的规模越来越大，功能越来越复杂，对验证和开发的要求越来越高，systemverilog无论在开发还是在验证上都有verilog/vhdl无可比拟的优越性。该文档是systemverilog标准的中文版，具有相当高的参考价值。
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评论信息
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yw734266731 :什么破玩意，exe运行不了2020-12-23 -
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weisusu0721 :很不错，感觉理论多些，多谢啦2013-08-20
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justin371 :这个是不错，不过如果是pdf就更好了2013-06-05
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lyynews :感觉是理论方面的多些。不太懂2013-03-31
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zealingzjx :这个不错，很全面，就是输出不方便2013-03-09
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taku2006 :exe版本， 查看起来很方便，windows下可运行2012-11-17
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obihsieh :執行失敗ㄟ...2012-07-02
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sxl37 :是exe版本的，和我之前下的一样，在windows下面很方便查看，linux下不能用2011-12-05
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