双调排序算法Verilog代码

上传者: 42224089 | 上传时间: 2024-01-12 16:13:17 | 文件大小: 360KB | 文件类型: ZIP
双调排序算法Verilog代码,包括仿真结果,适用于FPGA设计中对数值的排序,排序耗费硬件复杂度和时间复杂度随着排序序列中数值个数的上升而上升

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[{"title":"( 8 个子文件 360KB ) 双调排序算法Verilog代码","children":[{"title":"双调排序.png <span style='color:#111;'> 363.39KB </span>","children":null,"spread":false},{"title":"sim","children":[{"title":"tb_bitonic_sort.v <span style='color:#111;'> 4.42KB </span>","children":null,"spread":false}],"spread":true},{"title":"rtl","children":[{"title":"input_4_generator.v <span style='color:#111;'> 1.55KB </span>","children":null,"spread":false},{"title":"input_2_sequencer.v <span style='color:#111;'> 2.17KB </span>","children":null,"spread":false},{"title":"input_4_sequencer.v <span style='color:#111;'> 2.17KB </span>","children":null,"spread":false},{"title":"input_8_sequencer.v <span style='color:#111;'> 2.19KB </span>","children":null,"spread":false},{"title":"input_8_generator.v <span style='color:#111;'> 2.27KB </span>","children":null,"spread":false},{"title":"bitonic_sort_top.v <span style='color:#111;'> 1.19KB </span>","children":null,"spread":false}],"spread":true}],"spread":true}]

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