cadence 615中跑lvs流程

上传者: 39391931 | 上传时间: 2021-04-24 00:28:32 | 文件大小: 1.21MB | 文件类型: DOCX
lvs
在反向整理电路时需要与原始电路或网表进行比对来检测是否有错误变动。LVS(layout vs schematic)用来比对初始网表与整理后电路网表是否一致,以此判断整理电路过程是否出错。

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