xilinx fpga ddr3数据读写工程

fpga verilog ddr3 vivado

该资源为ddr3数据读写代码工程，由vivado2018.2编写。低版本的软件请参考附带的教程，自行配置ip核。开发板为ax7035，芯片为xc7a35tfgg484，ddr3芯片为16bit位宽，直接上板使用，其他芯片需更改相关输入输出管脚。module文件代码量少，适合初学者了解ddr3的读写操作。

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评论信息

qq_23961009 :

没找到ucf文件
2019-06-30
qq_23961009 :

没找到ucf文件
2019-06-30
mabrielchen :

没找到ucf文件啊大佬
2019-03-01
mabrielchen :

没找到ucf文件啊大佬
2019-03-01
wenze2010 :

上次下的不见了，重新下一个
2018-12-01
LAMDA-aUSER202104 :

上次下的不见了，重新下一个
2018-12-01

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