SHA256算法的verilog 实现

上传者: msm437 | 上传时间: 2021-05-18 21:38:35 | 文件大小: 6KB | 文件类型: ZIP
SHA256算法的verilog实现 IPCore 自动生成的FIFO和ROM没有上传 都是使用高端block memory 同时这里的rd_wr_dram模块是我实验室自己开发板子上的读写存控逻辑

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[{"title":"( 4 个子文件 6KB ) SHA256算法的verilog 实现","children":[{"title":"SHA256_top.v <span style='color:#111;'> 5.23KB </span>","children":null,"spread":false},{"title":"rd_wr_dram.v <span style='color:#111;'> 6.47KB </span>","children":null,"spread":false},{"title":"fuction.v <span style='color:#111;'> 1.35KB </span>","children":null,"spread":false},{"title":"SHA256.v <span style='color:#111;'> 8.16KB </span>","children":null,"spread":false}],"spread":true}]

评论信息

  • sailor001 :
    不过,可以用来试试看
    2017-07-04
  • zhu0915251058 :
    代码真实可靠,和论文上写的流程基本符合。具有很强的参考和借鉴意义,但是rd_wr_dram模块看起来比较费劲。希望作者能够进一步解释。那么这个代码就是特别成功的例子。
    2016-05-18
  • JepsonWong :
    不错,很有参考价值
    2016-01-04
  • qq_24827723 :
    不能直接用,但是可以参考一下
    2015-09-13
  • azpo2009 :
    雖然沒有IP CORE,還是可以參考
    2014-09-20

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