合肥工业大学《系统硬件综合设计》课程设计报告
合肥工业大学《系统硬件综合设计》课程设计报告
仅供学习与交流
1 设计要求
基于精简指令集架构完成一个多周期流水线CPU的设计，所设计的各类指令条数不少于10条，对于指令执行时可能产生的冒险与冲突，能够采取各种相应的方法合理解决，对于如何提高系统性能有一定的思考和策略，并能部分实现。在EDA软件上可以运行自己设计的测试程序并仿真验证所有设计的指令。例如：斐波拉契数列的显示，汇编代码的编写和编译。 （中）
1.1 CPU处理指令的过程
冯•诺伊曼型计算机[2]的CPU将指令和数据不加区分放在存储中，指令的处理过程需要访问存储。如图1所示，一条指令的处理通常可以分为5个阶段：取指令、指令译码、执行指令、访存取数和结果写回。
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