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基于verilog 设计的抢答器
基于verilog 设计的抢答器
上传者:
jmm18557
|
上传时间: 2021-06-14 14:07:12
|
文件大小: 1KB
|
文件类型: TXT
不是智能的
① 用EDA实训仪的I/O设备和PLD芯片实现电子抢答器的设计。 ② 电子抢答器具有1只主持人按钮和8只抢答选手按钮。 ③ 只有在主持人按钮按下后才开始抢答,当最先抢答的选手按钮按下后,其余选手的抢答按钮被封锁(无效)。 ④ 用EDA实训仪上的1只八段数码管显示抢答选手的序号
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评论信息
anhuchji :
感谢楼主分享,刚入手这块,还不是很懂,程序较清晰,学习了
2014-05-03
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