在FPGA中实现DDS(波形可选,频率可调,signaltap ii调试,有注释)

上传者: haoqiangqiang | 上传时间: 2019-12-21 19:50:40 | 文件大小: 2.07MB | 文件类型: rar
代码为verilogHDL编写,有三个按键:一个控制波形(方波和正弦波),一个控制频率增加,一个控制频率降低。代码有注释,并在signaltap ii中验证成功。

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评论信息

  • 神仙约架 :
    只有正弦波,不值这个价格
    2018-12-05
  • yinyin0729 :
    下完没有研究 是Verilog的 没用到
    2017-03-17
  • Hertz1239 :
    的确只有正弦波的额
    2014-02-18
  • hanyiren69 :
    我只找到了正弦波的,
    2013-10-11
  • asdasdasddd55 :
    只有正弦波,不怎么好
    2013-05-06

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