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[{"title":"（ 5 个子文件 2KB ） verilog编写的FIFO","children":[{"title":"FIFO设计","children":[{"title":"async_cmp.v <span style='color:#111;'> 703B </span>","children":null,"spread":false},{"title":"wptr_full.v <span style='color:#111;'> 832B </span>","children":null,"spread":false},{"title":"dp_ram.v <span style='color:#111;'> 516B </span>","children":null,"spread":false},{"title":"rptr_empty.v <span style='color:#111;'> 799B </span>","children":null,"spread":false},{"title":"async_fifo.v <span style='color:#111;'> 1.39KB </span>","children":null,"spread":false}],"spread":true}],"spread":true}]
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