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基于VHDL的数字频率计的设计
基于VHDL的数字频率计的设计
上传者:
cy601987107
|
上传时间: 2022-04-27 12:44:31
|
文件大小: 213KB
|
文件类型: DOC
VHDL
数字频率计
本设计采用EDA技术,利用测频法的原理和VHDL语言,采用自顶向下的设计方法,实现了1Hz~10kHz测量范围的四位十进制的数字频率计,并在MAX+PLUSⅡ软件平台下对设计项目进行的了编译和时序仿真。
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