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电子系统课程设计\基于FPGA的直接数字频率合成器的设计.doc
电子系统课程设计\基于FPGA的直接数字频率合成器的设计.doc
上传者:
chenchangpingok
|
上传时间: 2020-04-03 16:39:59
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文件大小: 6.16MB
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文件类型: DOC
电子系统课程设计
本设计是利用EDA技术设计的电路, 该信号发生器输出信号的频率范围为20Hz~20KHz,幅度的峰-峰值为0.3V~5V两路信号之间可实现0°~359°的相位差。侧重叙述了用FPGA来完成直接数字频率合成器(DDS)的设计
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