中文版Verilog HDL简明教程.chm
Verilog HDL是一种硬件描述语言，用于从算法级、门级到开关级的多种抽象设计层次的数字系统建模。被建模的数字系统对象的复杂性可以介于简单的门和完整的电子数字系统之间。数字系统能够按层次描述，并可在相同描述中显式地进行时序建模。
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评论信息
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qq1031768836 :打开看不了，感觉是网页形式的2016-01-19 -
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gtr1985 :讲的挺详细，很好2013-07-18
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lovinapple123 :讲得挺详细的，而且阅读起来很方便2013-06-24
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黑洞搜魂 :为啥我下载以后，打开显示不出内容捏。。。2013-03-29
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Luke12 :可作为参考，工作上还是主要熟悉quartus或ISE软件2012-07-05
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yunankuangke :是一本不错的FPGA教材，内容详实，知识点讲的也很清晰，很值得一读,谢谢2012-06-18
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