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cmos低噪声放大器设计实例
cmos低噪声放大器设计实例
上传者:
chaonanya
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上传时间: 2023-04-08 13:53:04
|
文件大小: 3.15MB
|
文件类型: PDF
cadence
LNA
本节通过一个 5.5GHz 低噪声放大器来讨论利用 Cadence IC 来进行低噪声放 大器原理图设计、仿真参数设置、版图绘制等基本方法和流程。 低噪声放大器的设计指标如下: 频率: 5.5GHz 增益: >15dB 噪声系数: <1.5dB 电压: 1.2V 本例选用 65nm CMOS 工艺来设计。
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