基于verilog的H264视频编解码开发
基于verilog的H264视频编解码开发
DF_top (clk,reset_n,gclk_DF,gclk_end_of_MB_DEC,gclk_DF_mbAddrA_RF,gclk_DF_mbAddrB_RAM,
end_of_BS_DEC,disable_DF,mb_num_h,mb_num_v,
bs_V0,bs_V1,bs_V2,bs_V3,bs_H0,bs_H1,bs_H2,bs_H3,
QPy,QPc,slice_alpha_c0_offset_div2,slice_beta_offset_div2,
blk4x4_sum_counter,blk4x4_rec_counter_2_raster_order,rec_DF_RAM_dout,
blk4x4_sum_PE0_out,blk4x4_sum_PE1_out,blk4x4_sum_PE2_out,blk4x4_sum_PE3_out,
DF_duration,end_of_MB_DF,DF_edge_counter_MR,one_edge_counter_MR,
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[{"title":"（ 100 个子文件 803KB ） 基于verilog的H264视频编解码开发","children":[{"title":"end_of_blk_decoding.v <span style='color:#111;'> 2.82KB </span>","children":null,"spread":false},{"title":"Inter_pred_reg_ctrl.v <span style='color:#111;'> 124.27KB </span>","children":null,"spread":false},{"title":"Intra_pred_PE.v <span style='color:#111;'> 69.16KB </span>","children":null,"spread":false},{"title":"DF_pipeline.v <span style='color:#111;'> 33.65KB </span>","children":null,"spread":false},{"title":"Intra_pred_reg_ctrl.v <span style='color:#111;'> 36.37KB </span>","children":null,"spread":false},{"title":"......","children":null,"spread":false},{"title":"<span style='color:steelblue;'>文件过多，未全部展示</span>","children":null,"spread":false}],"spread":true}]
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