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计算机组成原理寄存器堆设计实验
计算机组成原理寄存器堆设计实验
上传者:
bernicechl
|
上传时间: 2021-07-10 22:22:45
|
文件大小: 248KB
|
文件类型: DOC
文档及代码
1. 学习使用Verilog HDL语言进行时序电路的设计方法 2. 掌握灵活运用Verilog HDL语言进行行为级语言描述的技巧和方法; 3. 学习寄存器堆的数据传送和读写工作原理,掌握寄存器堆的设计方法.
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