华邦w25x16 SPIFlash Read ID FPGA(EP4CE6)实验Verilog逻辑源码Quartus工程文件+文档说明资料.rar
华邦w25x16 SPIFlash Read ID FPGA(EP4CE6)实验Verilog逻辑源码Quartus工程文件+文档说明资料，FPGA为CYCLONE4系列中的EP4CE6E22C8. 完整的工程文件，可以做为你的学习设计参考。
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** Modified date:
** Version:
** Descriptions: Read the Device ID of the W25X16 Flash
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********************************************************************************************************/
module W25X16 (
//input signal
input sys_clk ,
input sys_rst_n ,
input W25X16_DO ,
//output signal
output reg W25X16_CS ,
output reg W25X16_CLK ,
output reg W25X16_DIO ,
output reg [7:0] LED
);
//reg define
reg [5:0] counter ;
reg [5:0] clk_cnt ;
reg [15:0] shift_buf ;
//wire define
wire div_clk1 ;
wire div_clk2 ;
/*******************************************************************************************************
** Main Program
**
********************************************************************************************************/
//creat a clock about 1MHz
always @(posedge sys_clk or negedge sys_rst_n) begin
if ( sys_rst_n ==1'b0 )
clk_cnt <= 6'b0;
else
clk_cnt <= clk_cnt + 1'b1;
end
assign div_clk1 = clk_cnt[5];
assign div_clk2 = ~clk_cnt[5];
//get a counter that width is 6 bits
always @(posedge div_clk1 or negedge sys_rst_n) begin
if ( sys_rst_n ==1'b0 )
counter <= 6'b0;
else
counter = 8 && counter <= 58 )
W25X16_CS <= 1'b0;
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[{"title":"（ 20 个子文件 1.15MB ） 华邦w25x16 SPIFlash Read ID FPGA(EP4CE6)实验Verilog逻辑源码Quartus工程文件+文档说明资料.rar","children":[{"title":"w25x16_Read_ID","children":[{"title":"Project","children":[{"title":"W25X16.fit.rpt <span style='color:#111;'> 521.03KB </span>","children":null,"spread":false},{"title":"W25X16.done <span style='color:#111;'> 26B </span>","children":null,"spread":false},{"title":"W25X16.jdi <span style='color:#111;'> 4.08KB </span>","children":null,"spread":false},{"title":"RTL","children":[{"title":"W25X16.v <span style='color:#111;'> 4.80KB </span>","children":null,"spread":false},{"title":"W25X16.v.bak <span style='color:#111;'> 3.90KB </span>","children":null,"spread":false}],"spread":true},{"title":"W25X16.map.rpt <span style='color:#111;'> 116.16KB </span>","children":null,"spread":false},{"title":"W25X16.qsf <span style='color:#111;'> 15.87KB </span>","children":null,"spread":false},{"title":"W25X16.map.summary <span style='color:#111;'> 468B </span>","children":null,"spread":false},{"title":"stp1.stp <span style='color:#111;'> 100.68KB </span>","children":null,"spread":false},{"title":"W25X16.asm.rpt <span style='color:#111;'> 7.12KB </span>","children":null,"spread":false},{"title":"W25X16.fit.summary <span style='color:#111;'> 607B </span>","children":null,"spread":false},{"title":"W25X16.pin <span style='color:#111;'> 19.98KB </span>","children":null,"spread":false},{"title":"W25X16.flow.rpt <span style='color:#111;'> 15.38KB </span>","children":null,"spread":false},{"title":"W25X16.sof <span style='color:#111;'> 349.98KB </span>","children":null,"spread":false},{"title":"W25X16.fit.smsg <span style='color:#111;'> 513B </span>","children":null,"spread":false},{"title":"设计方案","children":[{"title":"W25X16详细设计方案.doc <span style='color:#111;'> 1.21MB </span>","children":null,"spread":false}],"spread":false},{"title":"W25X16.sta.rpt <span style='color:#111;'> 796.28KB </span>","children":null,"spread":false},{"title":"W25X16.qpf <span style='color:#111;'> 1.23KB </span>","children":null,"spread":false},{"title":"W25X16.cdf <span style='color:#111;'> 302B </span>","children":null,"spread":false},{"title":"W25X16.sta.summary <span style='color:#111;'> 1.60KB </span>","children":null,"spread":false}],"spread":false}],"spread":true}],"spread":true}]
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