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用FPGA模拟VGA时序,PS_2总线的键盘接口VHDL源代码.7z

2021-02-03 12:31:33 195KB 用FPGA模拟VGA时序 PS_

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活动图用例图时序图

2021-01-29 17:05:58 1.73MB 毕业论文

TimeGen时序图软件.rar

写代码画时序图用

2021-01-29 14:00:58 1.88MB 时序图

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流程图，时序图，建模等

界面简洁，美观，没有任何插件的流程图，时序图，建模工具

2021-01-28 12:15:30 104.17MB 流程图 时序图 画图

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3. 随机过程和深度学习-v3.pdf

从随机过程角度分析深度学习技术的应用

2021-01-28 04:57:53 867KB 深度学习 随机过程 时序分析 时序关系分析

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verilogFLASH读写时序

本文件为用Verilog写的FLASH S29AL032D读和擦除的驱动时序，对刚学习Verilog的同学有一定帮助，已在DE2开发板上验证。

2021-01-28 03:48:07 2KB verilogFLASH

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verilogFLASH读写时序

本文件为用Verilog写的FLASH S29AL032D读和擦除的驱动时序，对刚学习Verilog的同学有一定帮助，已在DE2开发板上验证。

2021-01-28 03:48:00 2KB verilogFLASH

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verilogFLASH读写时序

本文件为用Verilog写的FLASH S29AL032D读和擦除的驱动时序，对刚学习Verilog的同学有一定帮助，已在DE2开发板上验证。

2021-01-28 03:47:18 2KB verilogFLASH

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学生宿舍管理系统UML.rar

本资源内包含学生宿舍管理系统的用例图，活动图，时序图，类图，组件图，状态图等，每一类图都有分析文档，有需要的可以下载。

2020-12-25 13:33:40 1.35MB 统一建模语言 UML系列完整图 用例图，时序图，类图，活动图

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华科计算机组成原理实验单总线CPU设计(定长指令周期3级时序)(HUST)解题报告对应资源： https://blog.csdn.net/Spidy_harker/article/details/106296219

2020-11-03 13:11:49 481KB 华科计算机组成原理实验 单总线CPU设计 circ文件 单总线cpu设计(定长指令周期3

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