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EDA
数字钟(仿真无误,下载到实验板演示正确)
用quartues编写的数字中,正常计时(包括星期,小时,分,秒),整点报时,闹钟,彩铃。并能够清零,快速校分、校时。
2021-05-16 13:32:16
984KB
quartues+vhdl
1
EDA
课设-----数字秒表vhdl设计
eda
课设各分模块及顶层文件!提供个参考 希望对各位学习
eda
有帮助!
2021-05-16 11:56:55
3.26MB
EDA
数字秒表
VHDL
1
EDA
课程设计多功能数字钟设计
1正常的计时功能(采用试验箱上的1HZ信号源计时,能完成时分秒的正常计时含数码管显示时、分、秒) 2 计时调整(实现时分位上的手动调整) 3 整点报时(整点到前5秒开始报时,每秒一次,五次后停止) 4 闹钟(设定指定时刻闹钟提醒前5秒开始报时,每秒一次,五次后停止)
2021-05-15 20:52:34
128KB
数字钟
1
EL-
EDA
-VI基础实验说明书
EL-
EDA
-VI实验箱配套资料比较少,这里是在网上找到的关于EL-
EDA
-VI系列实验箱的基础实验说明书
2021-05-14 07:58:20
8.13MB
eda
EL-EDA-VI
1
英语字母显示电路设计
1、实现十六进制计数显示。 2、实现常见英语字母显示
2021-05-13 13:10:51
57KB
VHDL
EDA
1
EDA
Quartus13.0使用 1位全加器仿真.docx
数电初学者,有一定的数字逻辑电路知识 教你初等Quartus使用
2021-05-12 21:02:07
2.25MB
EDA
quartusII13.0
1位全加器
1
EDA
单稳态触发器.docx
设计FPGA逻辑,设计一个单稳态触发器,当按 下button2时,可以使DE0实验板上的发光二极管 LED4发光,经过2s后LED4熄灭,在LED4熄灭前再 次按下button2无效,当LED4熄灭后再次按下 button1可以重复上述的现象。
2021-05-12 20:26:03
999KB
verilog
1
24进制计数器数码管显示用VHDl编写.zip
24进制计数器数码管显示用VHDl编写
2021-05-12 18:43:13
53KB
EDA课程设计
1
i2sound_volume_control.zip
了解Quartus II开发环境,熟悉Verilog语言基本语法,了解I2C总线协议,通过代码控制音频编/解码硬件芯片WM8731,通过按键控制音频输出的音量,通过按键控制音频输出音量(可结合LCD显示音量等信息)。
2021-05-12 09:16:01
6.9MB
EDA
FPGA
1
出租车自动计费器的设计
设计一个出租车自动计费器,计费包括起步价、行车里程计费、等待时间计费3部分,用4位数码管显示金额、最大值为999.9元,最小计价单元为0.1元,行程3公里内,且等待累计时间3分钟内,起步费为8元,超过3公里,以每公里1.6元计费,等待时间单价为每分钟1元;用两位数码管显示等待时间,最大值为59min。出租车自动计费器的设计
2021-05-11 18:38:16
155KB
eda
vhdl
自动计费器
1
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