VHDL Quartus 异步D触发器源代码
--2015/11/25
--异步D触发器
LIBRARY IEEE; --调用库
USE IEEE.STD_LOGIC_1164.ALL; --库文件
USE IEEE.STD_LOGIC_UNSIGNED.ALL; --库文件
------------------------------------------------------------
ENTITY YBD IS --定义实体名,其名称必须与VHDL文本文件名称相同
PORT(
CLK: IN STD_LOGIC; --输入端口,时钟输入
DIN: IN STD_LOGIC; --输入端口,数据输入
RST: IN STD_LOGIC;
DOUT: OUT STD_LOGIC
); --输出端口,溢出标志