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Altera系列FPGA芯片IP核详解 高清pdf无水印。全书。解压后210多M。 Altera系列FPGA芯片IP核详解 Altera IP核是面向Altera可编程逻辑门阵列（FPGA）芯片优化的、实现电子设计中常用功能的封装模块。本书以Altera公司的Arria、HardCopy、Cyclone和Stratix系列FPGA芯片为基础，详细介绍各类IP核的特点、接口信号以及功能描述，并对部分IP核的信号时序进行分析。 全书共分9章，首先介绍在Quartus II软件中生成和使用Altera IP核方法，然后按照IP核的功能分类详细介绍用于数学运算、数据存储、数字信号处理（DSP）、通信和网络、图像处理、输入/输出、通信接口以及FPGA调试验证的Altera IP核。

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介绍了AES加密标准的Rijndael实现方法，设计了一种适合应用于嵌入式系统32位数据界面时序紧凑的AES加密IP核。该IP核能以较低的资源消耗实现在低端FPGA上速度为256 Mb/s的AES加密，且可将数据位宽扩展为64位或128位等，满足多种数据位宽应用的要求。该设计是一种低成本高性能的AES加密实现方法。