高性价比方案POE以太网供电系统基于MAX5969B和MAX5974A设计,主要应用于3.3V和5V POE用电器件。MAX5969B控制器完全兼容以太网供电(PoE)系统的IEEE:registered: 802.3af/at标准。器件也可由墙上适配器(WAD)供电。WAD的优先级高于PoE,由MAX5969B控制。MAX5974A控制40V至57V输入电压、电流模式PWM转换器,提供频率折返保护。高性价比方案POE以太网供电系统框图: MAX5974A提供高达21W电气隔离输出功率,采用PWM控制,使用同步整流反激DC-DC转换器拓扑。提供3.3V和5V输出。 当连接到IEEE 802.3af/at兼容的PSE时,参考设计使用两个通道的之一、全桥整流器将输入-57V转换为直流。如果无网络供电PSE可用,PCB焊盘V+和V-可用于为参考设计供电。MAX5969B通过VDD和RTN引脚为DC-DC电路供电。配置为21W输出功率时,Pasadena的效率达到89.8% (VIN = 48V)。表贴变压器和光耦提供高达1500V电气隔离。 Pasadena由电阻R4配置为4级的(12.95W至25.5W) PD分级。为重新配置PD分级,可替换表贴(0805)电阻R4。 PD分级选择 高性价比方案POE以太网供电系统电路及实物截图: 参考设计采用这些器件,兼容IEEE 802.3af/at标准;也是高性能、结构紧凑、高性价比方案,适用于支持高达4级功率水平的PD。
2023-02-17 11:03:21 1.57MB pwm控制 以太网供电 max5969b 电路方案
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Quartus Ⅱ 用户界面 基于QuartusⅡ的FPGA工程概述 综合
2023-02-16 20:43:45 1.63MB FPGA设计
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单个器件 仅原理图封装 使用需核对引脚
2023-02-16 19:49:08 38KB 国产FPGA紫光同创 PGL25G 原理图封装
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(1).掌握Verilog HDL模块的基本结构。 (2).掌握计数器的设计方法。 (3).掌握基于Quartus II的CPLD/FPGA开发流程。 (4).实验要求完成模24计数器程序设计,并完成Modelsim仿真
2023-02-16 19:42:39 281KB cpld FPGA
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针对传统磁通门信号处理电路中模拟元件的缺点,设计一种基于现场可编程门阵列(FPGA)的数字磁通门系统。整个系统采用闭环结构,由激励产生模块、信号处理拱块和负反馈模块组成。外围模拟电路用高速D/A、A/D芯片取代,有利于系统温度稳定性的提到。FPGA内的数字逻辑实现了磁通门信号解算、激励正弦信号发生、D/A、A/D输入/输出串并转换的功能,首先用硬件描述语言(HDL)设计并仿真,然后下载、配置到FPGA中,调试完成后进行实验,通过实时处理双铁芯磁通门传感器探头输出信号对系统进行测试。实验结果证实了系统功能的正确性。闭环结构的采用提高了系统信号梯度线性度,与模拟系统相比,基于数字逻辑的设计温度性能更稳定,更易于小型化,可移植性更强。
2023-02-16 13:03:20 180KB 传感器
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利用Carry4进行高精度TDC设计,其MATLAB测试分析代码
2023-02-16 10:55:04 405KB Carry4 fpga matlab
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FPGA与CF卡的接口设计、电子技术,开发板制作交流
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MAX262是CMOS双二阶通用开关电容有源滤波器,由微处理器精确控制滤波函数。可构成各种带通、低通、高通、陷波和全通配置,且不需外部元件。每个MAX262器件含有两个二阶滤波器,在程序控制下设置中心频率f0、品质因数Q和滤波器工作方式。
2023-02-15 19:36:29 2.5MB MAX262
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包含应用程序,驱动程序,固件源代码,三个部分,有使用说明,希望能对大家有所帮助。
2023-02-15 17:42:20 146KB FPGA USB 接口 VC
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用纯verilog实现测距码的产生,PN码
2023-02-15 15:53:12 5KB fpga开发
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