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基于matlab的IIR滤波器设计-基于matlab的IIR数字滤波器设计-刘智.doc
基于matlab的IIR滤波器设计-基于matlab的IIR数字滤波器设计-刘智.doc 全面的介绍IIR滤波器的设计
2022-12-29 21:11:44
505KB
matlab
1
开关电源论文
本设计应用隔离型回扫式DC-DC电源变换技术完成开关稳压电源的设计及制作。系统主要由整流滤波电路,DC-DC变换电路,单片机显示与控制电路三部分组成。
2022-12-29 17:19:03
79KB
开关电源
DC-
DC
整流滤波
1
中值滤波代码matlab-improved-median-filter:改进中值滤波器
中值滤波代码 matlab improved-median-filter More details plz visit This program outcome better than inbuild medfilt2 function
2022-12-29 14:22:42
4KB
系统开源
1
单片机与DSP中的滤波器有限字长效应
要求 分别用直接II型和级联结构实现例1中讨论的8阶二类Chebyshev低通IIR滤波器。如果采用乘法-累加-舍人结构并使用了扩展精度寄存器,求各滤波器的噪声功率增益。 解 两种方案的统计噪声功率增益均可通过计算Lyapun°v矩阵W的元素来得到。对直接II型方案而言,分析结果为W11=…=W88=0.35。已假设设计中使用的累加器为扩展精度,于是m1=1且m2=n13=…=m8=0。按缩放因子K=0.078进行校正后,可预计噪声功率增益为NPG=W11/K21=58.5或NG2=7.63,这相当于在IIR输出端损失了约3bit的精度。 级联结构中4级子滤波器的噪声功率增益的计算
2022-12-29 12:33:40
60KB
单片机与DSP中的滤波器有限字长效应
单片机与DSP
1
基于卡尔曼滤波和最大权值匹配实现的多目标跟踪python源码+详细代码注释+使用说明.zip
基于卡尔曼滤波和最大权值匹配实现的多目标跟踪python源码+详细代码注释+使用说明.zip 基于卡尔曼滤波和最大权值匹配实现的多目标跟踪python源码+详细代码注释+使用说明.zip 基于卡尔曼滤波和最大权值匹配实现的多目标跟踪python源码+详细代码注释+使用说明.zip 【备注】主要针对正在做毕设的同学和需要项目实战的深度学习cv图像识别模式识别方向、python、目标跟踪学习者。 也可作为课程设计、期末大作业。包含:项目源码、项目操作说明等,该项目可直接作为毕设使用。 也可以用来学习、参考、借鉴。
2022-12-28 16:27:27
15.9MB
卡尔曼滤波
最大权值匹配
多目标跟踪python源码
课程大作业
matlab数字图像处理课程作业-频率域滤波matlab源码.zip
matlab数字图像处理课程作业_频率域滤波matlab源码.zip matlab数字图像处理课程作业_频率域滤波matlab源码.zip matlab数字图像处理课程作业_频率域滤波matlab源码.zip
2022-12-28 16:27:23
971KB
matlab
数字图像处理
频率域滤波matlab源码
信息处理课程设计.rar
声音数据为两列,提取一列进行处理,声音的音量与数据的大小有关,不同的抽样频率会导致语音的语速音色等出现变化;截止频率对于语音信号的影响;调制频率对于语音信号的影响,还有截止频率对于调制频率的影响;不同滤波器的优缺点;噪声的产生与滤除;幅度谱控制语音信号的音量大小,相位谱控制语音信号的音调与节奏;变声的工作原理等。
2022-12-28 14:58:04
7.33MB
Matlab
GUI
数字信号处理
滤波器
1
直流稳压电源工作原理
直流稳压电源原理大解析,非常详细! 直流电源的组成、整流电路、滤波电路、倍压整流电路、稳压管稳压电路、串联型直流稳压电路、直流稳压器、开关型稳压器、可控整流电路等
2022-12-28 14:53:58
1.13MB
整流
滤波
1
基于FPGA的FIR数字滤波器设计实现
本设计是一个基于Altera Cycone Ⅳ系列的FPGA芯片实现一个37阶FIR数字滤波器,其中采样频率为13.5MHz,截止频率0.23MHz,窗口函数采用海明窗,算法为分布式算法。包含源程序及仿真文件,程序可直接用于板间调试
2022-12-28 13:19:59
15.79MB
FPGA
FIR滤波器
37阶
分布式算法
1
基于FPGA的灰度形态学滤波器实现
阐述了灰度形态学滤波的原理和基本操作,给出了3×3结构元素灰度形态学滤波器的硬件结构,详细描述了该滤波器在Xilinx公司的XC2S400E芯片上实现的过程和仿真的方法,并说明了需要注意的问题。
2022-12-27 15:30:35
182KB
FPGA
1
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