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2021-10-25 12:01:39 49KB

星级酒店节能减排方案.doc

2021-10-24 18:02:34 30KB

EDA技术与应用电子信息类 quartus仿真工程文件

2021-10-23 09:03:40 3.32MB D触发器 全减器 可加减控制的50进制加减计数器 EDA上机报告

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基于Verilog结构化建模的16位的全减器

代码是基于Verilog结构化建模的16位的全减器；设计参考本人上传资源中16位全加器设计，16位全减器由4个4位的全减器构成；4位全减器由4个1位的全减器构成；1位全减器由2个半减器和1个异或门构成。

2021-10-22 11:25:18 2KB verilog 全减器 减法器 结构化建模

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一年级上册数学小学数学PPT课件《连加连减》.ppt

2021-10-22 09:04:35 934KB

matlab voicebox等库+能熵比端点检测谱减降噪输出

包括了matlab音频处理入门的常用库及宋知用和张雪英教材的配套程序

2021-10-21 14:17:02 3.56MB matlab voicebox

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2021-10-21 14:02:13 45KB 小学教案

2021-10-21 14:02:12 45KB 小学教案

2021-10-21 14:02:12 28KB 小学教案

2021-10-21 14:02:12 43KB 小学教案