可编程片上系统（SOPC）是一种特殊的嵌入式系统，它设计方式灵活，具备软硬件在系统可编程功能。SOPC 在设计上以集成电路IP 核为基础，而自行开发的SOPC IP 核，根据实际硬件资源和功能任务需求来定制显示控制功能，可以增强系统可靠性和设计灵活性，降低了成本。目前针对LCD 显示屏设计的控制器IP 核文章较多[1-2],但对于TFT-LCD 触控屏设计的控制器IP 核文章较少[3],而且这类文章中很少见对控制器各个模块进行仿真验证内容。 　　文中提出一种针对TFT-LCD 触控屏控制器IP 核的设计方法。该控制器具有Avalon 总线接口，与其他标准IP 核一起构成以NiosⅡ为的片上系

快速傅立叶变换(FFT)作为时域和频域转换的基本运算，是数字谱分析的必要前提。传统的FFT使用软件或DSP实现，高速处理时实时性较难满足。FPGA是直接由硬件实现的，其内部结构规则简单，通常可以容纳很多相同的运算单元，因此FPGA在作指定运算时，速度会远远高于通用的DSP芯片。FFT运算结构相对比较简单和固定，适于用FPGA进行硬件实现，并且能兼顾速度及灵活性。本文介绍了一种通用的可以在FPGA上实现32点FFT变换的方法。

介绍了如何调用IP核设计FIR滤波器的全过程，并利用MATLAB进行了验证

快速傅立叶变换(FFT)作为时域和频域转换的基本运算，是数字谱分析的必要前提。传统的FFT使用软件或DSP实现，高速处理时实时性较难满足。FPGA是直接由硬件实现的，其内部结构规则简单，通常可以容纳很多相同的运算单元，因此FPGA在作指定运算时，速度会远远高于通用的DSP芯片。FFT运算结构相对比较简单和固定，适于用FPGA进行硬件实现，并且能兼顾速度及灵活性。本文介绍了一种通用的可以在FPGA上实现32点FFT变换的方法。

以Altera公司的Quartus Ⅱ 7.2作为开发工具，研究了基于FPGA的DDS IP核设计，并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件，结合32位嵌入式CPU软核Nios II，构成可编程片上系统（SOPC），利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片内完成，利用 SOPC技术，在一片 FPGA 芯片上实现了整个信号源的硬件开发平台，达到既简化电路设计、又提高系统稳定性和可靠性的目的。

CAN总线控制器的接口IP核设计与实现_胡小国.caj

介绍了AES加密标准的Rijndael实现方法，设计了一种适合应用于嵌入式系统32位数据界面时序紧凑的AES加密IP核。该IP核能以较低的资源消耗实现在低端FPGA上速度为256 Mb/s的AES加密，且可将数据位宽扩展为64位或128位等，满足多种数据位宽应用的要求。该设计是一种低成本高性能的AES加密实现方法。

介绍一种基于EDA技术实现ARINC429总线IP核的设计方法，并给出了在FPGA上的实现结果，以及该IP核在以PCI总线为主机接口的测试系统中的应用。与传统专用芯片相比，该IP核增加了单次或循环发送功能、深度触发主机中断接收，并可实现接收发送通道的多路扩展。经测试及实际应用证明该IP核功能设计高效合理，工作稳定可靠。

快速傅立叶变换(FFT)作为时域和频域转换的基本运算，是数字谱分析的必要前提。传统的FFT使用软件或DSP实现，高速处理时实时性较难满足。FPGA是直接由硬件实现的，其内部结构规则简单，通常可以容纳很多相同的运算单元，因此FPGA在作指定运算时，速度会远远高于通用的DSP芯片。FFT运算结构相对比较简单和固定，适于用FPGA进行硬件实现，并且能兼顾速度及灵活性。本文介绍了一种通用的可以在FPGA上实现32点FFT变换的方法。

基于FPGA光电容积脉搏波参数检测的IP核设计.pdf