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50nm工艺 CMOS bsim4模型

BSIM4 对应HSPICE level=54；对应PSPICE level=8

2019-12-21 21:39:46 11KB cadenc spice model

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7 带运放的带隙基准设计

介绍了带运放的的Bandgap的设计，并使用cadence ic5141对其进行仿真。

2019-12-21 20:43:13 291KB cadenc

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cadence 快捷键env文件

cadence 快捷键文件，在默认的env文件基础上进行修改，使操作更方便，文件内快捷键附有中文解释。

2019-12-21 19:53:32 13KB cadenc

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allegro元件库嘉立创标准元件库cadence版本

嘉立创标准元件库的cadence版本，AD转allegro16.6版本

2019-10-29 14:47:48 536KB allegr 嘉立创元件库 cadenc pcb封装库

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