在论坛上学习了一些关于递推最小二乘的原理和算法，参考了一些程序，写了一下关于递推最小二乘的程序，辨识结果没有问题。原理推导可以在论坛上查找。

ASP.NET框架应用程序实战--软件开发工程师岗前必备项目实战，广展物流物流管理系统（ZDSoft.LMS）源代码。

3.2 简简要要说说明明 3.2.1 C28x CPU 此F2833x (C28x+FPU)/F2823x (C28x)系列都属于 TMS320C2000™ 数字信号控制器 (DSC)平台。 基于 C28x+FPU 的控制器和 TI 现有的 C28xDSC具有相同的 32 位定点架构，但是还包括一个单精度（32 位） 的 IEEE 754 浮点单元（FPU）。 这是一个非常高效的的 C/C++ 引擎，它能使用户用高层次的语言开发他 们的系统控制软件。 这也使得能够使用 C/C++ 开发算术算法。 此器件在处理 DSP 算术任务时与处理系统 控制任务时同样有效而系统控制任务通常由微控制器器件处理。 这样的效率在很多系统中省却了对第二个处 理器的需要。 32 x 32 位 MAC 64 位处理能力使得控制器能够有效地处理更高的数字分辨率问题。 添加了 带有关键寄存器自动环境保存的快速中断响应，使得一个器件能够用最小的延迟处理很多异步事件。 此器件 有一个具有流水线式存储器访问的 8 级深受保护管道。 这个流水线式操作使得此器件能够在高速执行而无 需求助于昂贵的高速存储器。 特别分支超前硬件大大减少了条件不连续而带来的延迟。 特别存储条件操作 进一步提升了性能。 F2823x 系列也是 TMS320C2000™ 数字信号控制器(DSC) 平台的成员，但它不含浮点单元 (FPU)。 3.2.2 内内存存总总线线（（哈哈弗弗总总线线架架构构）） 与很多DSC类型器件一样，多总线被用于在内存和外设以及 CPU 之间移动数据。 C28x 内存总线架构包含 一个程序读取总线、数据读取总线和数据写入总线。 此程序读取总线由 22 条地址线路和 32 条数据线路组 成。 数据读取和写入总线由 32 条地址线路和 32 条数据线路组成。 32 位宽数据总线可实现单周期 32 位运 行。 多总线结构，通常称为哈弗总线，使得 C28x 能够在一个单周期内取一个指令、读取一个数据值和写入 一个数据值。 所有连接在内存总线上的外设和内存对内存访问进行优先级设定。 总的来说，内存总线访问 的优先级可概括如下： 最高级： 数据写入 （内存总线上不能同时进行数据和程序写入。） 程序写入 （内存总线上不能同时进行数据和程序写入。） 数据读取 程序读取 （内存总线上不能同时进行程序读取和取指令。） 最低级： 取指令 （内存总线上不能同时进行程序读取和取指令。） 3.2.3 外外设设总总线线 为了实现不同德州仪器 (TI)DSC系列器件间的外设迁移，2833x/2823x器件采用一个针对外设互连的外设总 线标准。 外设总线桥复用了多种总线，此总线将处理器内存总线组装进一个由 16 条地址线路和 16 条或者 32 条数据线路和相关控制信号组成的单总线中。 支持外设总线的三个版本。 一个版本只支持 16 位访 问（被称为外设帧 2）。 另外版本支持 16 位和 32 位访问（被称为外设帧 1）。 第三版本支持 DMA 访问 和 16 位以及 32 位访问（被称为外设帧 3）。 版权 © 2007–2012, Texas Instruments Incorporated 功能概述 41

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