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VHDL实现的数字频率计
VHDL实现的数字频率计,带QUARTUS工程文件,仿真通过,另外可以测试脉宽和占空比
2019-12-21 22:25:53
328KB
VHDL
数字频率计
1
15电赛国一数字频率计 单片机部分-STM32
这个是 15国赛 国一频率计 32407vet6的 mcu控制部分
2019-12-21 22:20:44
5.64MB
国赛
频率计stm32
部分
1
基于FPGA的等精度数字频率计
基于FPGA的等精度数字频率计,含代码的完整设计
2019-12-21 22:08:36
1.56MB
FPGA
1
15年数字频率计100MHZ.zip
完全实现2015年数字频率计所有要求,可达到100M频率测量
2019-12-21 21:56:45
23.42MB
电赛
STM32
FPGA
1
2015年电赛F题数字频率计完整工程代码(国一)
测量频率采用等精度法,信号通过高速比较器直接接入FPGA。本题难点是测量时间间隔,相对误差10^-2 ,时间间隔范围0.1US-100MS。因此时间的分辨率要达到1ns,也就是时钟频率要跑到1Ghz,大多数FPGA是不可能完成。本方案采用状态法测量时间间隔,采用PLL倍频出来的250Mhz,等效成1Ghz的采样频率,满足精度要求,工程代码完整分FPGA工程和stm32工程,转换公式注释明了。
2019-12-21 21:35:07
16.31MB
代码
1
EDA数字频率计 vhdl语言
EDA频率计 vhdlEDA频率计 vhdlEDA频率计 vhdlEDA频率计 vhdl
2019-12-21 21:32:43
1.29MB
频率计
1
仿真数字频率计实验报告
数字电路仿真实验报告,用Multisim软件仿真数字频率计。
2019-12-21 21:30:29
303KB
multisim仿真
1
数字频率计 VHDL代码
本科毕业设计用的非常简洁实用的代码,VHDL实现
2019-12-21 21:30:27
1.92MB
频率计
VHDL
1
2015全国大学生电子设计大赛F题一等奖--数字频率计
2015全国大学生电子设计大赛F题一等奖--数字频率计
2019-12-21 21:24:58
579KB
电子设计
1
基于FPGA的数字频率计设计
数字频率计的
设计,本文主要讲述了如何实现数字频率计采用EDA技术用VHDL编程实现,包括源代码和实验结果截图,很详细
2019-12-21 21:16:28
6.66MB
数字频率计
EDA数字频率计
频率计
VHDL
1
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