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一种低功耗射频CMOS电荷锁相环的设计。。。。。。。。。。。。。。。。。
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基于PROE二次开发的九孔柱塞缸体的毕业设计.
导读:本文首先介绍了锁相环系统的工作原理,其次重点分析了传统电荷电路存在的一些不理想因素,并在此基础上,提出了一种改进型的电荷电路,减小了锁相环的相位误差。此外,通过设计倍频控制模块,扩大了锁相环的锁频范围。   本文设计了一种宽频率范围的CMOS锁相环(PLL)电路,通过提高电荷电路的电流镜镜像精度和增加开关噪声抵消电路,有效地改善了传统电路中由于电流失配、电荷共享、时钟馈通等导致的相位偏差问题。   设计了一种倍频控制单元,通过编程锁频倍数和压控振荡器延迟单元的跨导,有效扩展了锁相环的锁频范围。该电路基于Dongbu HiTek 0.18μm CMOS工艺设计,仿真结果表明,在1
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