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掺铒光纤放大器的增益优化，本实验目的是针对波分复用输入光信号，通过对掺铒光纤（EDF）的长度和泵浦光源的功率参数值进行优化，使每个信道增益的差距在允许的范围之内，以达到所预期的各个信道的增益平坦谱。通过进行仿真实验，加深对于掺铒光纤放大器结构以及特性的理解，通过实验现象的分析，结合理论知识获得进一步的认识。

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Project1 VerilogHDL完成单周期处理器开发 一、设计说明 1.处理器应实现MIPS-Lite1指令集。 a)MIPS-Lite1＝{MIPS-Lite，addi，addiu， slt，jal，jr}。 b)MIPS-Lite指令集：addu，subu，ori，lw，sw，beq，lui，j。 c)addi应支持溢出，溢出标志写入寄存器$30中第0位。 2.处理器为单周期设计。 二、设计要求 3.单周期处理器由datapath(数据通路)和controller(控制器)组成。 a)数据通路由如下module组成：PC(程序计数器)、NPC(NextPC计算单元)、GPR (通用寄存器组，也称为寄存器文件、寄存器堆)、ALU(算术逻辑单元)、EXT(扩展单元)、IM(指令存储器)、DM(数据存储器)。 b)IM：容量为1KB(8bit×1024)。 c)DM：容量为1KB(8bit×1024)，采用小端序方式存取数据。 4.Figure1为供你参考的数据通路架构图。 a)我们不确保Figure1是完全正确的；我们也不确保Figure1能够满足MIPS-Lite1。 b)鼓励你从数据通路的功能合理划分的角度自行设计更好的数据通路架构。