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AHB
总线下的slave ram的verilog代码.rar
前段时间做一个项目时写的,对深入认识
AHB
协议非常有帮助,拿出来分享! 项目
2020-01-03 11:19:38
1KB
AHB总线
slave
ram
verilog
1
·IP项目实践:
AHB
-SRAM设计与验证 (AMBA 2.0
AHB
可以写入简历)
·IP项目实践:
AHB
-SRAM设计与验证 (AMBA 2.0
AHB
可以写入简历)
2019-12-21 22:22:13
1.53MB
AHB_SRAM
1
AHB
协议中文版
AMBA® 3
AHB
-Lite 协议,中文版。AMBA
AHB
-Lite是面向高性能的可综合设计,提供了一个总线接口来支持Master并提供高操作带宽。最普通的
AHB
-Lite从器件是内存器件,外部存储器接口和高带宽外围器件。虽然低带宽外围器件可以连接到
AHB
-Lite,但从系统性能考虑,应当连接到APB总线上,可以通过APB桥接实现。
2019-12-21 22:03:49
750KB
总线
ahb
1
AHB
接口代码
基于AMBA总线描述了一个
AHB
接口,采用多主多从的架构,有多个master和slave
2019-12-21 21:53:07
7KB
system
veril
AHB
多主多从
1
wishbone to
ahb
bus
wishbone to
ahb
bus. no burst operation.
2019-12-21 21:23:36
13.27MB
wishbone
ahb
1
multi_layer_
AHB
_overview.pdf
多层
ahb
总线概述多层
ahb
总线概述多层
ahb
总线概述多层
ahb
总线概述多层
ahb
总线概述
2019-12-21 21:02:01
125KB
多层ahb总线概述
1
DMA_
AHB
的verilog硬件实现
DMA的verilog硬件实现,此版本为东南大学2005年版本。目测可用。 网上有很多该版本,但是不全,此次为收集齐全的版本方便大家学习研究。(没有找到文档说明,代码注释较详细)
2019-12-21 20:33:32
27KB
DMA
Verilo
AHB
1
AHB
到APB总线转换的桥
AHB
、APB总线转换桥电路、verilog代码实现
2019-12-21 20:08:26
26KB
AHB、APB总线、桥
1
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