多周期CPU制作，烧纸到basy3板子，可运行，有四个状态。

针对大时带宽积对称三角形线性调频连续波信号模糊函数须考虑多普勒效应对复包络函数的影响，该文利用信号复包络求解法，导出了大时带宽积对称三角线性调频连续波信号的单周期与多周期模糊函数，研究了它们的对称性、模糊度图及沿主轴切割性质等特性。通过分析模糊函数表达式，得到了单、多周期信号的理论多普勒分辨率与时延分辨率。结果表明：单周期和多周期信号的时延分辨率相同，而N周期信号的多普勒分辨率提高到单周期信号的1/N。

Verilog多周期CPU设计文档CPU设计方案综述总体设计概述使用Verilog开发一个简单的多周期CPU，总体概述如下：此CPU为32位CPU此CPU为多周

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【verilog】中山大学计算机组成原理多周期CPU实验（代码+实验报告）

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用在MT4平台上的多周期同步复盘工具，很实用的指标。想象不用多说了解的朋友都懂得

多周期复盘脚本MTFVhands说明-纯中文版

一、设计说明 1.处理器应实现MIPS-Lite2指令集。 a)MIPS-Lite2＝{MIPS-Lite1，lb，sb}。 b)MIPS-Lite1＝{addu，subu，ori，lw，sw，beq，j，lui，addi，addiu，slt，jal，jr }。 c)addi应支持溢出，溢出标志写入寄存器$30中第0位。 2.处理器为多周期设计。 二、设计要求 3.多周期处理器由 datapath(数据通路)和 controller(控制器)组成。 a)数据通路应至少包括如下module：PC(程序计数器)、NPC(NextPC 计算单元)、GPR (通用寄存器组，也称为寄存器文件、寄存器堆)、ALU(算术逻辑单元)、EXT(扩展单元)、IM(指令存储器)、 DM(数据存储器)等。 b)IM：容量为1KB(8bit×1024)。 c)DM：容量为1KB(8bit×1024) ，采用小端序方式存取数据。 4.Figure1为供你参考的数据通路架构图。 a)我们不确保Figure1是完全正确的；我们也不确保Figure1能够满足MIPS-Lite2。 b)鼓励你从数据通路的功能合理划分的角