Middleton提出的Class-A类脉冲噪声模型,可以用于加在AWGN上
2024-04-27 00:01:28 2KB
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具有APB-BFM的DAC和ADC模型的UVM验证 这是一个小组项目。 具有APB BFM(总线功能模型)的UVM验证,已连接到两个只读DAC和两个只读ADC从器件。 该序列生成地址,并允许驱动程序告诉BFM选择哪个从站。 随后,四个监视器和记分板记录每个从站的测试结果。 top.sv顶部模块,包括测试,序列项,定序器和驱动程序 seq.svh序列 bfm_env.svh总线功能模型作为环境 intf.svh dac介面 adc_intf.svh adc接口 dac.sv给定的dac adc.sv给定的adc monitor1.svh DAC1监视器 monitor2_dac.svh DAC2监视器 monitor1_adc.svh ADC1监视器 monitor2_adc.svh ADC2监视器 记分板1.svh DAC1记分板 scoreboard2_dac.svh DAC2记分
2024-03-12 16:57:45 15KB SystemVerilog
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m序列生成 psk调制 误码率仿真 解扩
2024-03-08 09:17:19 7KB m序列生成 psk调制 误码率仿真
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基于随机解调的压缩采样技术是一种可以突破香农采样定理进行稀疏信号捕获的新颖方法。 在基于随机解调的采样系统中的主要挑战是随机序列的产生。 在本文中,我们介绍了一种生成高速随机序列的方法,该序列可以满足压缩采样的不连贯性。 所提出的技术采用了现场可编程门阵列(FPGA)。 首先,将随机序列并行存储在FPGA的存储器中,并使用低速时钟逐字节读取随机序列。 其次,低速字节序列由电路转换为高速位序列。 该提出的方法可以动态地对随机序列进行编程,而无需对电路系统进行任何更改。 实验结果表明,该方法产生的随机序列对信号的检测是可行的,所构建的系统可以压缩采样并重建稀疏信号。
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AOV网的拓扑序列生成 数据结构 设计程序完成如下功能:对给定的AOV网,产生所有的拓扑序列。提示:选择合适的数据结构表示AOV网。
2023-02-20 11:38:43 6KB AOV网
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用matlab编写程序,生成ZC序列,画出自相关函数与循环自相关函数
2022-10-26 09:10:09 139KB zc zc序列 zc序列生成 循环相关
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基于m序列生成LG模型序列,这是主要用于跳频序列的生成,可以设置频点、用户数等。
2022-10-12 10:09:24 1KB
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1. 基于序列的音乐生成系统 2. 内含数据集midi数据集 3. 环境搭建教程
2022-07-04 14:12:26 2.85MB 序列生成
基于matlab的gold序列生成器,希望对大家有用
2022-06-08 17:22:15 1KB mtalb
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采用verilog语言 生成m序列 用用一位寄存器原理
2022-05-26 16:28:46 232B M序列 verilog
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