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基于Cadence Virtuoso 设计平台的单片射频收发集成电路的设计过程
在当前通信市场的带动下,通信技术飞速向前发展,手持无线通信终端成为其中的热门应用之一。因此,单片集成的射频收发系统正受到越来越广泛的关注。典型的射频收发系统包括低噪声放大器(LNA)、混频器(Mixer)、滤波器、可变增益放大器,以及提供本振所需的频率综合器等单元模块,如图1 所示。对于工作在射频环境的电路系统,如2.4G 或5G 的WLAN 应用,系统中要包含射频前端的小信号噪声敏感电路、对基带低频大信号有高线性度要求的模块、发射端大电流的PA 模块、锁相环频率综合器中的数字块,以及非线性特性的VCO等各具特点的电路。众多的电路单元及其丰富的特点必然要求在这种系统的设计过程中有一个功能丰富且
2024-07-05 16:49:04
147KB
基于Cadence
Virtuoso
1
(精选)FPGA项目沙盘演练-基础版报文收发(vivado2017.4)
(详细项目内容请看对应博客正文,本资源为对应项目工程,含仿真文件) 一、项目要求 1.输入报文长度64~2048字节; 2.输入报文之间最小间隔为两拍; 3.输出报文的前两拍添加16bit报文长度信息;第1拍为报文长度高8位;第2拍为报文长度低8位;第3拍开始为输入报文; 二、项目方案 1. 要求输出报文,且报文输出在报文长度输出之后,所以需要先对输入报文进行缓存,根据输入报文的位宽和长度范围,此处选择合适的同步FIFO即可;(如果是IC,那么就需要自己写FIFO,可以参考本博客的FIFO介绍) 这里项目提出了第1个要求,掌握FIFO的使用。 2. 要求输出报文长度,所以需要对输入报文长度进行计数,并将其缓存; 此处有坑,若只用寄存器对长度进行缓存,存在被后续报文长度覆盖的风险,故需要第2个FIFO对报文长度进行缓存。 3. 要求先输出报文长度然后紧跟着输出报文,此处需要对时序进行设计,需要掌握FIFO的读写时序,需要理解fpga的时钟沿采样。 理解:时钟沿采样及数据下一时钟沿变化。
2024-07-04 15:30:25
31.18MB
fpga开发
FPGA项目
Verilog
STM32 UART DMA 收发数据
该代码同时支持stm32 f1 系列 的 三路USART 通道, 全部采用 DMA 自动收发数据, 通过中断返回判断数据是否收发完成。 代码已经测试通过可以,可以直接使用。在移植使用时需要注意,IO口 / 波特率 等信息
2024-06-25 13:36:42
4KB
STM32
USART
DMA
1
MAX2550-MAX2553收发器Femtocell无线参考设计-电路方案
MAX2550是完整的单芯片无线收发器,用于UMTS 1波段毫微微蜂窝(femtocell)应用。RD2550参考设计基于MAX2550和所有相关元件,设计并构建成极具竞争力的无线解决方案,支持基站收发信机(BTS)。工作频率范围:1920MHz至1980MHz (Rx)和2110MHz至2170MHz (Tx)。RD2550参考设计还支持周围宏蜂窝基站的下行信号检测,允许系统选择最佳的工作环境(功率、规范、频率、容量等)。 综述 该设计中,MAX2550作为主要的射频(RF)收发器,配合必要的外部元件构成完整的射频前端。外部元件包括:功率放大器、双工器、TCXO和无源器件。Maxim随RD2550参考设计提供一套完整的文件包,其中包括符合3GPP TS25.104家庭基站标准的测试报告。除RD2550外,我们还提供RD2551、RD2552、RD2553参考设计,分别基于MAX2551、MAX2552和MAX2553收发器构建,覆盖其它频带和标准。总之,您可以从Maxim获得高集成的单芯片毫微微蜂窝收发器,覆盖WCDMA 1-6波段和8-10波段,以及cdma2000:registered: 波段0、1和10。
2024-06-22 12:12:36
774KB
家庭基站
电路方案
1
2021年电赛E题《数字-模拟信号混合传输的无线收发机》山东省国二方案以及解析
2021年电赛E题《数字-模拟信号混合传输的无线收发机》,整个方案使用加法器将高频低频混合后AM调制实现发射,包络检波解调,方案简单易实现 虽然是国二,但是赛后分析调整,这里也提出了很多优化建议,现在公开方便大家复现,备赛电赛
2024-06-21 12:07:09
536KB
AM调制
1
数字无线电课程设计-基于带通采样结构的模拟普通调幅(AM )数字收发机的设计
基于带通采样结构的模拟普通调幅(AM )数字收发机的设计 1.调制信号为; 2.调制方式为普通AM,调制指数; 3.发射机采用正交调制方式; 4.接收机采用数字射频接收机方式完成,其数字前端尽可能采用高效结构; 5.调制载波为,采用短波AM广播频段,设置为学生学号后6位的4倍,如某同学学号为2017020901001,则该位同学应用的= 4×901001 =3,604,004Hz; 6.课程设计建议采用Matlab编程完成,设计报告和Matlab仿真程序提交电子档文件; 电子档文件通过云班课发送(或者发送给助教,email标题格式为“数字无线电课程设计-姓名-学号” ),电子档文件统一用.rar压缩文件格式,文件名格式为“数字无线电仿真报告-姓名-学号”。
2024-06-05 11:08:15
760KB
文档资料
STM32F407、405标准库串口数据收发-DMA
该程序是用标准库做的,hal库慢,用在步进电机控制等对速度有要求的项目上最为合适。 之前用STM32F405芯片上的,也可以移植到STM32F407。 程序已经测试,稳定可靠。
2024-06-04 20:46:53
2KB
stm32
DMA
UART串口通信
1
基于Javamail的邮件收发系统.zip
基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统.zip基于Javamail的邮件收发系统
2024-05-30 23:01:11
20.26MB
java
1
NRF24L01无线模块设计(PCB、原理图)AD版
NRF24L01无线收发模块设计,包含PCB和原理图
2024-05-27 12:08:23
80KB
NRF24L01
无线收发模块
易语言服务端客户端互换收发数据
易语言服务端客户端互换收发数据源码,服务端客户端互换收发数据,客户发送数据,服务发送数据,获取通信数据,服务过程连接,客户过程连接,客户数据处理,服务数据处理
2024-05-18 18:00:31
4KB
易语言服务端客户端互换收发数据源码
服务端客户端互换收发数据
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